Articles

From REuP Project

(Difference between revisions)
Jump to: navigation, search
Revision as of 23:01, 9 June 2010
Apiotro (Talk | contribs)

← Previous diff		 Revision as of 23:02, 9 June 2010
Apiotro (Talk | contribs)

Next diff →
Line 28: Line 28:
** File: [[Media:A_Unified_HardwareSoftware_Runtime_Environment_for_FPGA_using_BORPH_(2006).pdf|download]] ** File: [[Media:A_Unified_HardwareSoftware_Runtime_Environment_for_FPGA_using_BORPH_(2006).pdf|download]]
** Description: Podazajac tropem Piotrka natrafilem na ciakawy artykul (w zalaczniku) prezentujacy opracowany w Berkeley system operacyjny (rozszerzenie UINX'a) dla architektur opartych o FPGA. Artykul jest dosc "swiezy" bo z 2006 roku. Co wiecej, w Transactions on Embedded Computing Systems 2008 znalazlem artykul tych samych autorow, o tym samym tytule (niestety, nie udalo mi sie dotrzec do jego tresci). Zasadnicza czesc proponowanego systemu pracuje na procesorze PowerPC znajdujacym sie w glownym FPGA. Oprocz glownego FPGA sa jeszcze 4 uklady "user FPGA", w ktorych realizowane sa zadania uzytkownika. Osiagnieciem autorow jest ujednolicenie obslugi zadan implementowanych sprzetowo i programowo. Choc glowna koncepcja przedstawiona w artykule znacznie rozni sie od naszego pomyslu to warto go przeczytac ze wzgledu na prezentowane w nim mechanizmy komunikacji miedzy zadaniami i dostepu do pamieci. Lekture polecam szczegolnie naszym informatykom. Jak widac z artykulu, odpowiednia architektura sprzetu moze znacznie przyspieszyc prace systemu operacyjnego. Mocna strona artykulu jest to, ze nie przedstawia on jedynie luznych koncepcji ale konkretne, sprawdzone rozwiazania. ** Description: Podazajac tropem Piotrka natrafilem na ciakawy artykul (w zalaczniku) prezentujacy opracowany w Berkeley system operacyjny (rozszerzenie UINX'a) dla architektur opartych o FPGA. Artykul jest dosc "swiezy" bo z 2006 roku. Co wiecej, w Transactions on Embedded Computing Systems 2008 znalazlem artykul tych samych autorow, o tym samym tytule (niestety, nie udalo mi sie dotrzec do jego tresci). Zasadnicza czesc proponowanego systemu pracuje na procesorze PowerPC znajdujacym sie w glownym FPGA. Oprocz glownego FPGA sa jeszcze 4 uklady "user FPGA", w ktorych realizowane sa zadania uzytkownika. Osiagnieciem autorow jest ujednolicenie obslugi zadan implementowanych sprzetowo i programowo. Choc glowna koncepcja przedstawiona w artykule znacznie rozni sie od naszego pomyslu to warto go przeczytac ze wzgledu na prezentowane w nim mechanizmy komunikacji miedzy zadaniami i dostepu do pamieci. Lekture polecam szczegolnie naszym informatykom. Jak widac z artykulu, odpowiednia architektura sprzetu moze znacznie przyspieszyc prace systemu operacyjnego. Mocna strona artykulu jest to, ze nie przedstawia on jedynie luznych koncepcji ale konkretne, sprawdzone rozwiazania.
 +
 +* Generating the Communications Infrastructure for Module-based Dynamic Recon¯guration of FPGAs
 +** Authors: Shannon Koh
 +** Year: 2003
 +** File: [[Media:OS_for_FPGA.pdf|download]]
 +** Description: Po krotce mowiac, praca dotyczy opracowania narzedzi i metodologii (COMMA design flow opartej na Early Access Partial Reconfiguration Tool Flow) wspierajacych synteze ukladow wykorzystujacych modulowa rekonfiguracje dynamiczna na wspoczesne uklady rekonfigurowalne XILINX'a (rodzina Spartan-4) i jednoczesnie wspolpracujace z dostepnymi narzedziami producenta. Glowny nacisk w pracy polozony zostal na generacje i optymalizacje polaczen pomiedzy modulami dynamicznie rekonfigurowalnymi. Zaproponowane podejscie umozliwia zachowanie takich paramterow projektu jak np. ograniczenia czasowe, przy jednoczesnym spadku czasu dynamicznej rekonfiguracji do okolo 64% (w porownaniu do zastosowania dostepnych komercyjnie narzedzi). Autor w pracy implementuje model Brebnera ("fixed wiring harness" model), a tazke algorytm greedy'ego do łączenia grafow wsparte, rozwiniete czy tez nawet zastapione przez metode dynamicznego programowania.

Revision as of 23:02, 9 June 2010

  • Research Issues in Operating Systems for Reconfigurable Computing
    • Authors: Grant B. Wigley and David A. Kearney
    • Year: 2002
    • File: download
    • Description: Polecam wszystkim (szczegolnie informatykom) ciekawy artykul p.t. "Research Issues in Operating Systems for Reconfigurable Computing". Artykul nie jest bardzo "swiezy" bo z 2002 r ale rozwaza wiele podstawowych kwesti dotyczacych systemu operacyjnego dla ukladow rekonfigurowalnych (RC - Reconfigurable Computing).
  • ReConfigME: A Detailed Implementation of an Operating System for Reconfigurable Computing
    • Authors: Grant Wigley, David Kearney and Mark Jasiunas
    • Year: 2006
    • File: download
    • Description:
  • VEBoC: Variation and Error-Aware Design for Billions of Devices on a Chip
    • Authors: Shoaib Akram, Scott Cromar, Gregory Lucas, Alexandros Papakonstantinou, Deming Chen
    • Year:
    • File: download
    • Description: Zalaczony artykul przedstawia cos podobnego do tego, co chcemy zrealizowac, choc troche innego w koncepcji - application-specific multicores.
  • Operating Systems for FPGA Based Computers and Their Memory Management
    • Authors: Klaus Danne
    • Year:
    • File: download
    • Description: Witam wszystkich, przesyłam dość ciekawy artykuł opisujący zadania systemu operacyjnego w dynamicznie rekonfigurowalnym FPGA (zarządzanie dostępem do pamięci, virtual adressing, dynamiczna alokacja itp). Chociaż zaprezentowane rozwiązania są bardzo ogólne, to uważam, że warto ten artykuł przeczytać.
  • A Unified Hardware/Software Runtime Environment for FPGABased Reconfigurable Computers using BORPH
    • Authors: Hayden KwokHay So, Artem Tkachenko and Robert Brodersen
    • Year: 2006
    • File: download
    • Description: Podazajac tropem Piotrka natrafilem na ciakawy artykul (w zalaczniku) prezentujacy opracowany w Berkeley system operacyjny (rozszerzenie UINX'a) dla architektur opartych o FPGA. Artykul jest dosc "swiezy" bo z 2006 roku. Co wiecej, w Transactions on Embedded Computing Systems 2008 znalazlem artykul tych samych autorow, o tym samym tytule (niestety, nie udalo mi sie dotrzec do jego tresci). Zasadnicza czesc proponowanego systemu pracuje na procesorze PowerPC znajdujacym sie w glownym FPGA. Oprocz glownego FPGA sa jeszcze 4 uklady "user FPGA", w ktorych realizowane sa zadania uzytkownika. Osiagnieciem autorow jest ujednolicenie obslugi zadan implementowanych sprzetowo i programowo. Choc glowna koncepcja przedstawiona w artykule znacznie rozni sie od naszego pomyslu to warto go przeczytac ze wzgledu na prezentowane w nim mechanizmy komunikacji miedzy zadaniami i dostepu do pamieci. Lekture polecam szczegolnie naszym informatykom. Jak widac z artykulu, odpowiednia architektura sprzetu moze znacznie przyspieszyc prace systemu operacyjnego. Mocna strona artykulu jest to, ze nie przedstawia on jedynie luznych koncepcji ale konkretne, sprawdzone rozwiazania.
  • Generating the Communications Infrastructure for Module-based Dynamic Recon¯guration of FPGAs
    • Authors: Shannon Koh
    • Year: 2003
    • File: download
    • Description: Po krotce mowiac, praca dotyczy opracowania narzedzi i metodologii (COMMA design flow opartej na Early Access Partial Reconfiguration Tool Flow) wspierajacych synteze ukladow wykorzystujacych modulowa rekonfiguracje dynamiczna na wspoczesne uklady rekonfigurowalne XILINX'a (rodzina Spartan-4) i jednoczesnie wspolpracujace z dostepnymi narzedziami producenta. Glowny nacisk w pracy polozony zostal na generacje i optymalizacje polaczen pomiedzy modulami dynamicznie rekonfigurowalnymi. Zaproponowane podejscie umozliwia zachowanie takich paramterow projektu jak np. ograniczenia czasowe, przy jednoczesnym spadku czasu dynamicznej rekonfiguracji do okolo 64% (w porownaniu do zastosowania dostepnych komercyjnie narzedzi). Autor w pracy implementuje model Brebnera ("fixed wiring harness" model), a tazke algorytm greedy'ego do łączenia grafow wsparte, rozwiniete czy tez nawet zastapione przez metode dynamicznego programowania.
Retrieved from "http://reup.dmcs.pl/wiki/index.php/Articles"
Personal tools